 班级规模及环境--热线:4008699035 手机:15921673576( 微信同号) |
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坚持小班授课，为保证培训效果，增加互动环节，每期人数限3到5人。 |
| 上课时间和地点 |
上课地点：【深圳分部】：电影大厦(地铁一号线大剧院站)/深圳大学成教院 【上海】：同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【北京分部】：北京中山学院/福鑫大楼 【南京分部】：金港大厦(和燕路) 【武汉分部】：佳源大厦（高新二路） 【成都分部】：领馆区1号（中和大道） 【沈阳分部】：沈阳理工大学/六宅臻品 【郑州分部】：郑州大学/锦华大厦 【广州分部】：广粮大厦 【西安分部】：协同大厦 【石家庄分部】：河北科技大学/瑞景大厦
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| 实验设备 |
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| 质量保障 |
1、培训过程中，如有部分内容理解不透或消化不好，可免费在以后培训班中重听；
2、课程完成后,授课老师留给学员手机和Email,保障培训效果,免费提供课后答疑。
3、培训合格学员可享受免费推荐就业机会。 |
课程大纲 |
课程介绍：
高性能FPGA系统的设计实现需要研究包括设计方法学、算法和系统结构、代码优化和综合、设计和实现工具等关键问题。只有学习掌握好这几个方面的知识，并深刻理解他们的关系，才能做到从总体上把握全系统，从而设计出满足要求的高性能数字系统。所谓“会当凌绝顶，一览众山小”正是这样一种感觉。
FPGA系统设计实质上是一个同步时序系统的设计，理解时序概念，掌握代码优化与综合技术，正确完整地进行时序约束和分析是实现高性能系统的重要保证。本期课程按照“从宏观到微观，从顶层到底层”的系统设计原则，以“时序分析”和“系统集成”为主线，深入探讨了“FPGA和FPGA数字系统”、“FPGA时序设计与时序分析”、“FPGA高级资源”、“面向时序性能的FPGA代码设计与综合技术”以及“FPGA高速I/O接口时序设计与分析”5大主题。
课程讲师均来自相关领域科研一线，具有扎实的理论功底和丰富的实践经验。课程内容结合了国外同类培训课程内容和培训讲师的科研教学实践，理论丰富，实验合理，具有非常强的系统性和实用性，可以引导学员快速提高FPGA数字系统设计水平，更快创建设计，缩短开发时间，降低开发成本。
培训对象：
课程适合于使用FPGA器件进行科研和产品开发的具有中等以上水平的工程技术人员，也适合于相关专业领域具有相当水平的教师和研究生。
1、工具平台：Xilinx ISE 14.7
2、授课大纲
3.1 数字系统概述
3.2 FPGA和FPGA数字系统
3.3 FPGA时序设计与时序分析
3.4 面向时序性能的FPGA代码设计与综合技术
3.5 FPGA新资源
3.6 FPGA高速I/O接口设计 |
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