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       坚持小班授课，为保证培训效果，增加互动环节，每期人数限3到5人。
   上课时间和地点
上课地点：【深圳分部】：电影大厦(地铁一号线大剧院站)/深圳大学成教院 【上海】：同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【北京分部】：北京中山学院/福鑫大楼 【南京分部】：金港大厦(和燕路) 【武汉分部】：佳源大厦（高新二路） 【成都分部】：领馆区1号（中和大道） 【沈阳分部】：沈阳理工大学/六宅臻品 【郑州分部】：郑州大学/锦华大厦 【广州分部】：广粮大厦 【西安分部】：协同大厦 【石家庄分部】：河北科技大学/瑞景大厦
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   质量保障

        1、培训过程中，如有部分内容理解不透或消化不好，可免费在以后培训班中重听；
        2、课程完成后,授课老师留给学员手机和Email,保障培训效果,免费提供课后答疑。
        3、培训合格学员可享受免费推荐就业机会。
课程大纲
 
  1. 嵌入式语言之利用 VHDL 进行设计培训
      利用 VHDL 进行设计培训
    课程对象
    希望有效利用 VHDL 进行数字设计的建模、设计和综合的工程师
  2. 课程概要
    1
    VHDL 的“形状”
    实验1：使用工具
    VHDL 内的技术文档
    数据类型
    并行操作
    实验2：使用并行语句
    工艺和变量
    实验3：设计简单工艺
    2
    测试平台简介
    ISim 仿真工具基础知识
    实验4：简单设计仿真
    创建存储器
    实验5：构建双端口存储器
    有限状态机
    实验6：构建摩尔有限状态机
    针对 Xilinx FPGA
    实验7：Xilinx 工具流程
    3
    回路和条件优化
    实验8：使用回路
    特性
    功能和程序
    封装和库
    实验9：构建您自己的封装
    与仿真互动
    编写良好的测试平台
    实验10：构建有意义的测试平台

  3.  
     
     
     

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